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기 술 명
파워 온 리셋 회로
연 구 자
하동수(정보통신공학부)
등록번호
10-1024676-00-00
출원번호
10-2008-0033041
문 의 처
문희곤062-715-3077hgmoon@gist.ac.kr
발명정보

본 발명의 파워 온 리셋 회로는, 파워 온 리셋 신호와 클럭에 응답하여 초기값 입력 신호를 생성하는 입력 제어 수단; 상기 초기값 입력 신호에 응답하여 카운팅 동작을 수행하여 카운트 옵셋 신호를 생성하는 카운팅 수단; 및 상기 카운트 옵셋 신호에 응답하여 카운팅 동작을 수행하여 상기 파워 온 리셋 신호를 생성하는 파워 온 리셋 수단;을 포함하는 것을 특징으로 한다.

발명효과

본 발명의 파워 온 리셋 회로는, 전원과 클럭이 안정화되면 기 설정된 옵셋 값까지의 카운팅 동작을 수행하는 디지털 타입으로 구현됨에 따라, PVT 변화 등에 의한 오동작을 감소시킴으로써, 파워 온 리셋 신호의 안정성을 향상시키는 효과가 있다.

대표청구항

파워 온 리셋 신호와 클럭에 응답하여 초기값 입력 신호를 생성하는 입력 제어 수단; 상기 초기값 입력 신호에 응답하여 카운팅 동작을 수행하여 카운트 옵셋 신호를 생성하는 카운팅 수단; 및 상기 카운트 옵셋 신호에 응답하여 카운팅 동작을 수행하여 상기 파워 온 리셋 신호를 생성하는 파워 온 리셋 수단; 을 포함하는 것을 특징으로 하는 파워 온 리셋 회로.