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기 술 명
직접 디지털 주파수 합성기
연 구 자
김기선(정보통신공학부)
등록번호
10-0327036-00-00
출원번호
10-2000-0000240
문 의 처
문희곤062-715-3077hgmoon@gist.ac.kr
발명정보

본 발명은 디지털 통신 시스템, 디지털 신호 처리시스템에 사용하는 고성능 직접 디지털 주파수 합성기에 관한 것으로, 본 발명의 직접 디지털 주파수 합성기는 인가되는 주파수 제어 워드(frequency tuning word : FTW)를 이용하여 샘플된 위상 데이터를 생성하는 위상 가산기와 상기 샘플된 위상 데이터에 대해 그 위상에 대응하는 디지털 사인 값을 계산하여 출력하는 사인 함수 생성기를 포함한다. 또한, 상기 위상 가산기는: 상기 주파수 제어 워

발명효과

본 발명에서 제안하는 코딕 알고리즘에 기반한 직접 디지털 주파수 합성기는 고속의 디지털 통신 시스템이나 디지털 신호처리 시스템 구성 시, 하드웨어에 복잡성을 크게 줄이는데 효과적으로 사용될 수 있다. 실제 9 비트 이상의 정밀도를 갖는 코딕에 기반한 고성능 직접 디지털 주파수 합성기의 경우, 기존의 ROM을 이용한 고성능 직접 디지털 주파수 합성기의 구조보다 훨씬 적은 하드웨어 비용을 가지며, ROM을 사용하는 경우와 거의 동일한 동작속도를 지원한다. 따라서 9 비트 이상의 정밀도를 요구하는 고성능 직접 디지털 주파수 합성기의 구현은 ROM을 사용하는 방법보다 본 발명에서 제시한 코딕 알고리즘을 이용하는 방법이 하드웨어 비용을 줄이는데 효과적이다.

대표청구항

고성능 직접 디지털 주파수 합성기에 있어서, 인가되는 주파수 제어 워드(frequency tuning word : FTW)를 이용하여 샘플된 위상 데이터를 생성하는 위상 가산기; 상기 샘플된 위상 데이터에 대해 그 위상에 대응하는 디지털 사인 값을 계산하여 출력하는 사인 함수 생성기를 포함하며; 상기 위상 가산기는: 상기 주파수 제어 워드를 일시 저장하는 j 비트 주파수 레지스터; 매 클럭 마다 상기 j 비트 주파수 레지스터에 저장된 주파수 제어 워드와 이전의 샘플된 위상 데이터와 가산하여 사인 함수 파형을 생성하기 위한 샘플된 위상을 생성하는 j 비트 가산기; 상기 j비트 가산기에 의해 생성된 샘플된 위상을 저장하며, 상기 저장된 샘플된 위상 데이터는 다음 클럭에서 상기 j 비트 주파수 레지스터에 저장된 주파수 제어워드와 가산되는 상기 이전의 샘플된 위상 데이터로서 사용되는 위상 레지스터를 구비하며; 상기 사인 함수 생성기는: 상기 위상 레지스터로부터 제공되는 위상 데이터를 반전시키는 제 1 보수기; 상기 제 1 보수기에 의해 반전된 위상 데이터를 하기 수학식 [수학식] 을 통하여 반복회전 변형하는 코딕 프로세서로서, 상기 수학식에서 [x 0 , y 0 ]는 상기 위상데이터의 직교 좌표이고, θ(i)는 회전각이고, K는 일정한 비례확대 상수(scaling factor)이고, (θ-δ)는 n번째 반복 회전 후의 전체 회전된 각도이고, σ(i)는 매 i번째의 회전에서의 θ(i)의 부호이며, δ는 각 근사화 오차이며; 상기 코딕 프로세서의 출력값을 반전시켜 상기 디지털 사인 값을 생성하는 제 2 보수기를 구비하는 것을 특징으로 하는 고성능 직접 디지털 주파수 합성기.